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為什麼PCB上的單端阻抗控制50歐姆

來源:一博自媒體 時間:2016-1-20 類别:微信自媒體

作者:周偉  一博科技高速先生團隊隊員   阻抗序列文章

很多剛接觸阻抗的人都會有這個疑問,為什麼常見的闆内單端走線都是預設要求按照50歐姆來管控而不是40歐姆或者60歐姆?這是一個看似簡單但又不好回答的問題。在寫這篇文章前我們也查找了很多資料,其中最有知名度的是Howard Johnson, PhD關于此問題的答複,原文可以詳見如下連結:http://www.edadoc.com/cn/TechnicalArticle/Show.aspx?id=815,相信很多人都有看過。

為什麼說不好回答呢?信号完整性問題本身就是一個權衡取舍的問題,是以在業内最著名的一句話也就是:"It depends……" 這就是沒有标準答案,仁者見仁智者見智的一個問題。今天高速先生也就這個問題綜合各種答複來簡單總結下,在此也是抛磚引玉,希望更多的人可以從各自的角度出發總結出更多相關的因素。

首先,50歐姆是有一定曆史淵源的,這得從标準線纜說起。我們都知道近代電子技術很大一部分是來源于軍隊,慢慢的軍用轉為民用,在微波應用的初期,二次世界大戰期間,阻抗的選擇完全依賴于使用的需要。随着技術的進步,需要給出阻抗标準,以便在經濟性和友善性上取得平衡。在美國,最多使用的導管是由現有的标尺竿和水管連接配接成的,51.5歐姆十分常見,但看到和用到的擴充卡/轉換器又是50歐姆到51.5歐姆;為聯合陸軍和海軍解決這些問題,一個名為JAN的組織成立了,就是後來的DESC,由MIL特别發展的,綜合考慮後最終選擇了50歐姆,并且特别的導管被制造出來,并由此轉化為各種線纜的标準。此時歐洲标準是60歐姆,不久以後,在象Hewlett-Packard這樣在業界占統治地位的公司的影響下,歐洲人也被迫改變了,是以50歐姆最終成為業界的一個标準沿襲下來,也就變成約定俗成了,而和各種線纜連接配接的PCB,為了阻抗的比對,最終也是按照50歐姆阻抗标準來要求了。

其次,從線路闆制作可實作的角度出發,50歐姆實作起來比較友善。從前面阻抗計算公式可知,過低的阻抗需要較寬的線寬以及薄媒體(或較大的介電常數),這對于目前高密闆來說空間上比較難滿足;過高的阻抗又需要較細的線寬及較厚的媒體(或較小的介電常數),不利于EMI及串擾的抑制,同時對于多層闆及從量産的角度來講加工的可靠性會比較差;而50歐姆在常用材料的環境下普通的線寬和媒體厚度(4~6mil)即符合設計要求(如下圖一阻抗計算),又友善加工,慢慢的成為預設選擇也就不足為奇了。

第三,從損耗的角度出發,根據基本的實體學可以證明50歐姆阻抗趨膚效應損耗最小(摘自Howard Johnson, PhD的回複)。通常電纜的趨膚效應損耗L(以分貝做機關)和總的趨膚效應電阻R(機關長度)除以特性阻抗Z0成正比。總的趨膚效應電阻R是屏蔽層和中間導體電阻之和。屏蔽層的趨膚效應電阻在高頻時,和它的直徑d2成反比。同軸電纜内部導體的趨膚效應電阻在高頻時,和他的直徑d1成反比。總共的串聯電阻R,是以和(1/d2+1/d1)成正比。綜合這些因素,給定d2和相應的隔離材料的介電常數Er,可以用以下公式來使得趨膚效應損耗最小。

為什麼PCB上的單端阻抗控制50歐姆

在任何關于電磁場和微波的基礎書中,都可以找到Z0是d2,d1和Er的函數。

為什麼PCB上的單端阻抗控制50歐姆

把公式2代入公式1中,分子分母同時乘以d2,整理得到           

為什麼PCB上的單端阻抗控制50歐姆

從公式3分離出常數項( /60)*(1/d2),有效的項((1+d2/d1)/ln(d2/d1))來确定最小值點。仔細檢視公式3的最小值點僅由d2/d1控制,和Er以及固定值d2無關。以d2/d1為參數,為L做圖,顯示d2/d1=3.5911時,取得最小值。假定固态聚乙烯的介電常數為2.25,d2/d1=3.5911 得出特性阻抗為51.1歐姆。很久之前,無線電工程師為了友善使用,把這個值近似為50歐姆作為同軸電纜最優值。這證明了在50歐姆附近,L是最小的。

最後,從電氣性能的角度看,50歐姆的優勢也是綜合考慮之後的折中。單純從PCB走線的性能來說,阻抗低比較好,對一個給定線寬的傳輸線,和平面距離越近,相應的EMI會減小,串擾也會是以減小,同時也不易受容性負載影響。但從全路徑的角度看,還需要考慮最關鍵的一個因素,那就是晶片的驅動能力,早期大多數晶片驅動不了阻抗小于50歐姆的傳輸線,而更高阻抗的傳輸線由于實作起來不便,是以折中采用了50歐姆阻抗。

綜上所述:50歐姆作為業界的預設值有其先天的優勢,同時也是綜合考慮後的折中方案,但并不是說就一定要用50歐姆阻抗了,很多時候還是取決于與之比對的接口,如75歐姆仍然是遠端通訊的标準,一些線纜和天線都是使用的75歐姆,此時就需要與之比對的PCB線路阻抗。另外還有一些特殊的晶片通過改善晶片驅動能力,來降低傳輸線的阻抗,以此得到更好的抑制EMI和串擾的效果,如Intel的多數晶片要求阻抗控制在37歐姆、42歐姆甚至更低,在此不再贅述。

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