長期以來，Achronix為不同行業的資料密集型和高帶寬應用提供了創新性的FPGA産品和技術，并幫助客戶不斷打破性能極限。其中一些應用需要與先進的模拟/數字轉換器（ADC）和數字/模拟轉換器（DAC）進行對接——可由JESD204C完美地完成這項任務。
JESD204B/C是由JEDEC定義和開發的高速資料轉換器串行接口标準。該标準減少了高速資料轉換器和其他高性能器件（如Achronix Speedster7t FPGA）之間的資料輸入和輸出數量。這種數字和模拟信号鍊的組合使設計人員能夠獲得簡化的小尺寸電路闆布局，同時不會對終端系統的性能産生不利影響，進而使設計人員受益。通過高速通用I/O（GPIO）或SerDes通道來實作資料轉換器件之間的接口/互連。
Achronix在其Speedster7t FPGA器件上已經實作了JESD204C接口，使客戶能夠使用他們所選擇的ADC或DAC。由于是在同構FPGA架構上實作了軟的JESD204C接口，客戶可以使用他們喜歡的ADC/DAC器件并使其設計實作定制化。本文讨論了基于Achronix Speedster7t FPGA器件的JESD204C解決方案。
Achronix JESD204C解決方案支援該标準提及的所有功能，并對以前的版本進行改善。旨在實作由标準機構提出的所有的四個目标：
•提高通道速率以支援所需的更高總帶寬——Achronix的解決方案目前支援每SerDes通道高達24.75 Gbps的資料速率。SerDes可以支援32 Gbps的JESD204C上限通道速率。用于測試設計的資料轉換器使用的是Analog Devices（ADI）的AD9082，它支援的最大資料速率為24.75 Gbps。
•提升有效載荷傳輸效率——Achronix的使用者可以使用FPGA邏輯來對其設計進行定制和優化。
•鍊路穩健性——Achronix的解決方案展示了在單通道和多通道模式鍊路的高度穩健性，同時保持确定性的延遲。例如，對于那些沒有量化效應的模式，采樣率可以達到AD9082支援的最高極限。
•向後相容先前的JESD204B版本——Achronix将會提供JESD204B解決方案。
實驗室測試方案
Achronix已成功實作并示範了Speedster7t JESD204C的解決方案，該解決方案可連ADI的AD9082，AD9082帶有四通道16位DAC和雙通道12位ADC轉換件。實驗環回設定（如圖1所示）包括以下元件：
•Bittware的VectorPath S7t-VG6加速卡。闆上使用的是Achronix Speedster7t FPGA器件。
•連接配接VectorPath和ADI的EVAL-AD9082連接配接器。Achronix開發了一塊4-lane的QSFP到FMC的連接配接器，如果有需要的話，還可以調整為8通道或16通道。
•配備FMC連接配接器的ADI EVAL-AD9082 ADC/DAC闆卡。
•所需的測試裝置和其它配件。
圖1：連接配接VectorPath和ADI的EVAL-AD9082連接配接器闆卡
實驗設定給發送（Tx）的和接收（Rx）的方向上提供完整的信号鍊。各元件的功能如下：
•在VectorPath加速卡上的Speedster7t AC7t1500 FPGA器件中實作JESD204C發送/接收IP功能。通過連接配接的PC上的Linux控制台運作特定的測試腳本。
•Speedster7t SerDes通道通過定制的FMC-QSFP連接配接器闆卡連接配接到ADC/DAC。QSFP28子產品支援四個SerDes通道，每個通道的運作速度為24.75 Gbps。
•通過所連PC調用API，完成對ADI的AD9082-FMCA-EBZ評估闆上數千個寄存器進行程式設計配置。另外，也可以使用FPGA上的軟CPU核或SoC中的硬CPU核對寄存器進行程式設計配置。
•外部時鐘源使VectorPath加速卡和AD9082-FMCA-EBZ評估闆同步。也可以通過使用AD9082-FMCA-EBZ上的振蕩器來生成内部時鐘，并通過FMC-QSFP連接配接器饋送到VectorPath加速卡。
•由一個任意波形發生器（AWG）産生波形被通過外部直傳送給ADC0和ADC1。
•環回發生在Speedster7t FPGA内部，處于JESD204C接收和發送子產品之間，而DAC輸出顯示在示波器上。
•DAC0和DAC1輸出的預期波形顯示在連接配接的示波器上。
圖2：四通道環回示例
上圖顯示了一個四通道環回配置。信号路徑為AWG（I/Q信号）→AD9082-FMCA-EBZ（ADC）→FMC QSFP56→Speedster7t JESD204C Rx→環回→Speedster7t JESD204C Tx→FMC QSFP56→AD9082-FMCA-EBZ （DAC）→示波器。
AD9082-FMCA-EBZ的ADC0和ADC1的輸入I/Q波形具有相同的頻率，但相位相差90度。頻率取決于AD9082-FMCA-EBZ支援的模式，該設定可以在最小且可接受的抖動下，實作該特定模式所聲明的最高頻率。
基于Speedster7t FPGA器件，實作的先進的Achronix JESD204C解決方案，可以實作JESD204C資料轉換器所支援的最高速率。該解決方案為連接配接的ADC/DAC裝置提供了一個與供應商無關的接口，進而支援客戶可以選擇他們喜歡的ADC/DAC供應商。