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- vivado設計流程：
【基于zynq的卷積神經網絡加速器設計】（一）熟悉vivado和fpga開發流程：使用Vivado硬體調試燒寫hello-world led閃爍程式實作及vivado軟體仿真一、硬體調試二、軟體仿真 note：
分析與綜合 和 限制輸入 可以調換順序
【基于zynq的卷積神經網絡加速器設計】（一）熟悉vivado和fpga開發流程：使用Vivado硬體調試燒寫hello-world led閃爍程式實作及vivado軟體仿真
- 一、硬體調試
-
- （一）建立工程
- （二）設計輸入
- （三）分析
- （四）限制輸入
- （五）綜合、實作、生成比特流
- 二、軟體仿真
-
- （一）步驟
- （二）仿真界面指導
一、硬體調試
（一）建立工程
- new project
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（二）設計輸入
- add source
【基于zynq的卷積神經網絡加速器設計】（一）熟悉vivado和fpga開發流程：使用Vivado硬體調試燒寫hello-world led閃爍程式實作及vivado軟體仿真一、硬體調試二、軟體仿真 - create design source
【基于zynq的卷積神經網絡加速器設計】（一）熟悉vivado和fpga開發流程：使用Vivado硬體調試燒寫hello-world led閃爍程式實作及vivado軟體仿真一、硬體調試二、軟體仿真 - create file
【基于zynq的卷積神經網絡加速器設計】（一）熟悉vivado和fpga開發流程：使用Vivado硬體調試燒寫hello-world led閃爍程式實作及vivado軟體仿真一、硬體調試二、軟體仿真 - 命名（一般頂層子產品名和工程名保持一緻）、ok
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【基于zynq的卷積神經網絡加速器設計】（一）熟悉vivado和fpga開發流程：使用Vivado硬體調試燒寫hello-world led閃爍程式實作及vivado軟體仿真一、硬體調試二、軟體仿真 - 端口信号不做定義，點選ok
【基于zynq的卷積神經網絡加速器設計】（一）熟悉vivado和fpga開發流程：使用Vivado硬體調試燒寫hello-world led閃爍程式實作及vivado軟體仿真一、硬體調試二、軟體仿真 - 輕按兩下建立的.V檔案，然後在代碼編輯區域輸入代碼
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（三）分析
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open elaborated design
verilog轉換rtl
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（四）限制輸入
- io planing
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選擇管腳和管腳電平
自行在自己開發闆對應的原理圖手冊查找
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打開xdc檔案
這個檔案可以做IO限制 或者 時序限制
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note：
限制這裡可以自己添加限制檔案
（五）綜合、實作、生成比特流
-
點選generate bitstream
點選generate bitstream後，vivado會自動跑綜合和實作。提示框點選yes即可
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可以點選project summary檢視進度
圖中在綜合
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跑完了後會彈出以下框框
選擇選項3再按ok，或者直接按左邊的按鈕open hardware manager
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【基于zynq的卷積神經網絡加速器設計】（一）熟悉vivado和fpga開發流程：使用Vivado硬體調試燒寫hello-world led閃爍程式實作及vivado軟體仿真一、硬體調試二、軟體仿真 - 驗證成功
二、軟體仿真
（一）步驟
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右鍵添加
建立激勵檔案（testbench檔案）
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根據自己需求功能編寫信号激勵
這裡主要是時鐘和複位信号
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結果：
9. 點選所例化的檔案，将cnt信号拖入信号欄
自行檢視結果即可
（二）仿真界面指導
- 按鈕指導：
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檢視時鐘周期
間隔的兩個上升沿分别add marker
單擊左邊藍線，可見間隔為20ns，符合代碼 【基于zynq的卷積神經網絡加速器設計】（一）熟悉vivado和fpga開發流程：使用Vivado硬體調試燒寫hello-world led閃爍程式實作及vivado軟體仿真一、硬體調試二、軟體仿真 【基于zynq的卷積神經網絡加速器設計】（一）熟悉vivado和fpga開發流程：使用Vivado硬體調試燒寫hello-world led閃爍程式實作及vivado軟體仿真一、硬體調試二、軟體仿真 -
注意的是
代碼定義的計數器的值太大，這裡隻仿真1000ns，如果要跑仿真實際結果，需要很長時間，是以要麼就等待，要麼就修改計數器的值來模拟即可。
改完代碼直接儲存，并且relunch即可
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儲存波形檔案
ctrl+s 儲存即可
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