邏輯綜合

邏輯綜合——優化電路
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Design Compiler指南——施加設計限制一、時序和面積二、環境屬性
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邏輯綜合 DC的一些注意事項（雜談）
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邏輯綜合——施加限制
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DC_LAB3——LCD控制子產品的綜合過程綜合流程：
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03-23
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DC_LAB2——Timing Constraints學習目标Lab FlowDesign SchematicDesign Specification實驗步驟
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DFT 視訊學習筆記：第一 introduction
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